ZHCSWQ7A June 2024 – December 2024 TDA4APE-Q1 , TDA4VPE-Q1
PRODUCTION DATA
請參考 PDF 數(shù)據(jù)表獲取器件具體的封裝圖。
表 6-76、圖 6-92、表 6-77 和圖 6-93 說明了 MMC1/2 的時序要求和開關(guān)特性 - UHS-I SDR25 模式。
編號 | 最小值 | 最大值 | 單位 | ||
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SDR251 | tsu(cmdV-clkH) | 建立時間,在 MMC[x]_CLK 上升沿之前 MMC[x]_CMD 有效 | 2.1 | ns | |
SDR252 | th(clkH-cmdV) | 保持時間,在 MMC[x]_CLK 上升沿之后 MMC[x]_CMD 有效 | 1.67 | ns | |
SDR253 | tsu(dV-clkH) | 建立時間,在 MMC[x]_CLK 上升沿之前 MMC[x]_DAT[3:0] 有效 | 2.1 | ns | |
SDR254 | th(clkH-dV) | 保持時間,在 MMC[x]_CLK 上升沿之后 MMC[x]_DAT[3:0] 有效 | 1.67 | ns |
編號 | 參數(shù) | 最小值 | 最大值 | 單位 | |
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fop(clk) | 工作頻率,MMC[x]_CLK | 50 | MHz | ||
SDR255 | tc(clk) | 周期時間,MMC[x]_CLK | 20 | ns | |
SDR256 | tw(clkH) | 脈沖持續(xù)時間,MMC[x]_CLK 高電平 | 9.2 | ns | |
SDR257 | tw(clkL) | 脈沖持續(xù)時間,MMC[x]_CLK 低電平 | 9.2 | ns | |
SDR258 | td(clkH-cmdV) | 延遲時間,MMC[x]_CLK 上升沿到 MMC[x]_CMD 轉(zhuǎn)換 | 2.4 | 9.37 | ns |
SDR259 | td(clkH-dV) | 延遲時間,MMC[x]_CLK 上升沿到 MMC[x]_DAT[3:0] 轉(zhuǎn)換 | 2.4 | 9.37 | ns |